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Verilog HDL與CPLD/FPGA項目開發教程 版權信息
- ISBN：9787111313656
- 條形碼：9787111313656 ; 978-7-111-31365-6
- 裝幀：暫無
- 冊數：暫無
- 重量：暫無
- 所屬分類：>
Verilog HDL與CPLD/FPGA項目開發教程 本書特色
《Verilog HDL與CPLD/FPGA項目開發教程》：全國高等職業教育規劃教材
Verilog HDL與CPLD/FPGA項目開發教程 目錄
出版說明前言第1章 CPLD，FPGA項目開發入門1．1 CPLD／FPGA開發系統概述1．1．1 PLD的發展歷程及發展趨勢1．1．2 CPLD／FPGA概述1．1．3 CPLD／FPGA的結構與原理1．2 CPLD／FPGA器件識別1．2．1 CPLD／FPGA產品概況1．2．2 MAX系列產品的基本功能及編程方式1．3 CCITCPLD／FPGA實驗儀使用1．3．1 實驗儀結構設計1．3．2 熟悉實驗儀的元器件1．3．3 解析主控芯片EPMl270T144C51．3．4 了解實驗儀的外圍接口及其引腳對應關系1．3．5 設計實驗儀原理圖1．3．6 設計Byte Blastel下載口1．4 QuartusⅡ開發環境應用1．4．1 安裝QuartusIl7．2開發環境1．4.2 設計三人表決器1．5 Verilog HDL語言基礎應用1．5．1 認識Verilog HDL語言基本結構1．5．2 辨別Verilog HDL語言數據類型1．5．3 識別Verilog HDL語言運算符及表達式1．6 Verilog HDL語言實例設計1．6．1 閃爍燈設計1．6．2 流水燈設計1．7 習題第2章 基于CPLD，FPGA的單元項目開發2．1 項目l設計基本邏輯門電路2．2 項目2設計譯碼器2．2．1 任務1設計3．8譯碼器2．2．2 任務2設計八段LED數碼管譯碼電路2．3 項目3編碼器和數據選擇器設計2．3．1 任務l設計8-3優先編碼器2．3．2 任務2設計4．1數據選擇器2．4 項目4觸發器設計2．4．1 任務l觸發器概述2．4．2 任務2識別基本觸發器2．4．3 任務3識別觸發器的邏輯功能2．4．4 任務4設計時鐘觸發器2．4．5 任務5設計直接置位復位觸發器2．4．6 任務6轉換不同邏輯功能的觸發器2．5 項目5全加器設計2．5．1 任務1設計一位全加器2．5．2 任務2設計串行進位加法器2．5．3 任務3設計先行進位加法器2．5．4 任務4設計加減法器2．6 項目6計數器設計2．6．1 任務1設計二進制計數器2．6．2 任務2設計七進制計數器2．6．3 任務3采用異步置數和同步清零的方法設計七進制計數器2．7 項目7乘法器設計2．7．1 任務1利用被乘數左移法設無符號乘法器2．7．2 任務2利用部分積右移法設無符號乘法器2．7．3 任務3設計帶符號乘法器2．8 項目8除法器設計2．8．1 任務1利用比較法設計除法器2．8．2 任務2利用恢復余數法設計除法器2．8．3 任務3利用不恢復余數法設計除法器2．9 項目9鍵盤LED發光二極管應用設計2．9．1 任務1鍵盤LED發光二極管應用之2．9．2 任務2鍵盤LED發光二極管應用之二2．9．3 任務3鍵盤去抖動設計2．10 項目10靜、動態LED發光二極管顯示2．10．1 任務1靜態數碼管的顯示設計2．10．2 任務2動態數碼管顯示設計2．11 項目11點陣LED顯示屏及其漢字顯示2．11．1 任務1點陣LED顯示屏測試2．11．2 任務2漢字顯示2．12 項目12蜂鳴器應用設計2．12．1 任務1發出報警聲2．12．2 任務2設計簡易數字電子琴2．12．3 任務3設計“梁祝”音樂片段2．13 項目13LCD液晶顯示系統設計2．13．1 任務1了解液晶顯示的基礎知識2．13．2 任務2液晶屏滾動顯示“www．ccit．is．cn”字符2．14 習題第3章 基于CPLD，FPGA的綜合項目開發3．1 項目1基于VerilogHDL的數字時鐘設計與實現3．1．1 任務1任務提出及設計分析3．1．2 任務2分頻模塊設計3．1．3 任務3校時模塊設計3．1．4 任務4計時處理模塊設計3．1．5 任務5報時模塊設計3．1．6 任務6顯示模塊設計3．1．7 任務7頂層模塊設計3．1．8 任務8下載調試運行3．2 項目2基于VerilogHDL的交通信號燈模擬控制設計3．2．1 任務1任務提出及設計分析3．2．2 任務2初始化模塊設計3．2．3 任務3分頻模塊設計3．2．4 任務4控制A方向4盞燈亮火模塊設計3．2．5 任務5控制B方向4盞燈亮滅模塊設計3．2．6 任務6A、B方向各種燈剩余時間的顯示模塊設計3．2．7 任務7頂層文件設計3．2．8 任務8下載調試運行3．3 項目3UART異步串行通信設計3．3．1 任務l串行通信基礎知識3．3．2 任務2串行發送模塊設計3．3．3 任務3串行接收模塊設計3．4 項目4基于VerilogHDL的四路數字式競賽搶答器設計3．4．1 任務1任務提出及設計分析3．4．2 任務2信號鎖存電路設計3．4．3 任務3計分電路設計3．4．4 任務4數碼管顯示電路設計3．4．5 任務5頂層文件設計3．4．6 任務6下載調試運行3．5 習題附錄附錄A Verilog HDL關鍵字附錄B Quartusl L7．2支持的Verilog HDL數據類型和語句附錄C 基于Verilog HDL的CPLD／FPGA設計常見問題解析附錄D 高級語言的串行通信編程參考文獻
展開全部
Verilog HDL與CPLD/FPGA項目開發教程 節選
《Verilog HDL與CPLD/FPGA項目開發教程》以Altera公司的MAXII系列EPMl270T144C：5N為藍本闡述了基于CPLD／FPGA的數字系統設計方法，重點放在工程實踐能力和Verilog HDL硬件描述語言的編程開發能力方面。《Verilog HDL與CPLD/FPGA項目開發教程》按照基于工作過程的以“項目”為載體的教學模式的思路進行編寫，“項目”的選取以直觀、生動、有趣、實用為原則，并遵循由易到難、由簡單到綜合的學習規律。全書共3章，第1章主要介紹CPLD／FPGA項目開發入門，包括CPLD／FPGA開發系統概述、0uartusⅡ開發環境的使用、Verilog HDL硬件描述語言編程基礎；第2章以13個單元項目為載體來介紹組合邏輯電路設計、時序邏輯電路設計和數字系統設計（如鍵盤、數碼管、液晶、點陣屏、音樂等外圍接口的驅動）；第3章以電子時鐘、交通信號燈控制、串行通信、數字式競賽搶答器4個綜合項目為載體，介紹用Verilog HDL硬件描述語言進行綜合項目開發的一般步驟，使讀者在實踐中鍛煉編程、調試和創新能力，形成良好的編程風格。附錄中給出了數字系統設計中的常見問題解析。《Verilog HDL與CPLD/FPGA項目開發教程》可作為高職高專電子工程、計算機、微電子、自動控制等相關專業電子設計自動化（Electronic Design Automation，EDA）課程的教材，也可作為EDA初學者或工程技術人員的參考資料。
Verilog HDL與CPLD/FPGA項目開發教程 相關資料
插圖：隨著電子設計自動化（EDA）技術的不斷發展，其含義也在不斷發生變化，早期的電子設計自動化多指類似Protel電路版圖的設計自動化概念，這種概念僅限于電路元器件與元器件之問（即芯片外）設計自動化，而由于微電子技術的不斷發展，當今的EDA技術則更多的是指可編程邏輯器件的設計技術，即芯片內的電路設計自動化。也就是說，開發人員完全可以通過自己的電路設計來定制其芯片內部的電路功能，使之成為設計者自己的專用集成電路（ASIC）芯片。這就是我們今天所說的的EDA技術——用戶PLD（可編程邏輯器件）技術。它的應用無處不在，從簡單的邏輯電路、時序電路設計到復雜的數字系統設計，從通信領域（軟件無線電）、數字信號處理（DSP）領域，到嵌入式／片上系統（SOC）及各種IP內核等諸多領域。如果說原來的Tango（Protel）問世在電子設計領域是一次革命的話，那么，今天的CPLD／FPGA技術稱得上是電子設計領域的第二次革命。隨著可編程器件PLD技術的不斷發展和崛起，其功能之卓越和先進已經令當今的電子工程師們贊嘆不已，除了它設計靈活、仿真調試方便、體積小、容量大、I／O口豐富、成本低廉、易編程和加密等優點外，更突出的特點是其芯片的在系統可編程技術。也就是說，它不但具有可編程和可再反復編程的能力，而且只要把器件插在用戶自己設計的目標系統內或線路板上，就可以重新構造其設計邏輯而對器件進行編程或者反復編程，這種技術被稱為在系統可編程技術，簡稱ISP技術。由于ISP技術的應用，打破了產品開發時必須先編程后裝配的慣例，而可以做到先裝配后編程，成為產品后還可以在系統內反復編程和修改。ISP技術使得系統內硬件的功能像軟件一樣被編程配置，使系統的升級和維護變得更容易和方便。可以說，可編程器件真正做到了硬件的“軟件化”自動設計。
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